FPGA開発日記

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あけましておめでとうございます

あけましておめでとうございます。本年も、本ブログをよろしくおねがい致します。

昨年は、

  • RISC-Vをベースとした自作ISS/RTL設計
  • Vivado-HLSの勉強
  • 技術翻訳で文書2本を翻訳

など、様々なことに手を出した一年でした。

今年の目標として、

  • ZedBoardを用いて、RISC-VとARMの連携など(オペレーティングシステム、ソフトウェアスタックも含む)
  • Vivado-HLSを使った実装の発展
  • TensorFlowなどの理解を深める
  • バイルアプリケーションの開発に挑戦してみたい

去年の目標も継続しているけども!

頑張っていきたいと思います。