FPGA開発日記

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2019-02-20から1日間の記事一覧

Vivado-HLSを使って高位合成でCPUを作ってみる(4. RTL合成後のシミュレーションとサイクル測定)

Vivado-HLSを使って簡単なRISC-V CPUを作ってみている。 とりあえず基本的なパタンが動くようになったので、Co-Simulationの実施とサイクル測定を実施する。 Co-Simulationを実施すると、RTLシミュレーションでも無事に動作していることが確認できた。 では…