FPGA開発日記

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2025-09-26から1日間の記事一覧

簡単なVerilogの回路実装をSymbiYosysのフォーマル検証を試す (1. ラウンドロビンアービタの設計)

SymbiYosysの能力を検証するために、簡単なサンプルデザインを作ってフォーマル検証を行っていく。 まずは、以下のような形のラウンドロビンアービタを作ったうえで、機能検証を行う。 module rr_arbiter2 #( parameter N = 4 ) ( input logic i_clk, input …