FPGA開発日記

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2025-09-04から1日間の記事一覧

RISC-V Formal Verification Framework (riscv-formal) についてまとめる (3. 信号の定義)

前回の続きだ。メモリアクセスの検証用インタフェースについて見てみよう。 msyksphinz.hatenablog.com 外部メモリバスの処理 RISC-V Formalの仕様では、RVFI経由で観測されるコアが生じさせるメモリアクセスと、それに伴って発生するデータバス上で観測され…