FPGA開発日記

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2022-02-26から1日間の記事一覧

自作RISC-VコアをYosysで合成する試行 (2. sv2v によるデザインの修正試行、の以前)

前回、自作コアをYosysで合成しようとしてSystemVerilogの文法制約の影響でコンパイルに失敗したのだった。 GitHub Issueにはsv2vを使うように指示があったのでそれを試行してみようとした。 github.com 以下でインストールを試みる。 git clone https://git…