FPGA開発日記

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2020-09-23から1日間の記事一覧

GoogleのSystemVerilog ParserであるVeribleを試す(2)

GoogleのSystemVerilog Parserの続き。さらにいくつかコマンドがあるので探っていく。 verible-verilog-syntax これがおそらくSyntax解析エンジンの最も中心的なコマンドであろう。Verilogファイルを読み取って階層構造を出力する。階層構造を出力するために…