FPGA開発日記

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2019-11-03から1日間の記事一覧

FIRRTLに入門する (1. ビルドとVerilog生成テスト実行)

FIRRTLというのはハードウェア記述言語Chiselのバックエンドに相当する部分で、Chisel→FIRRTL→Verilogという段階を取り、FIRRTL→VerilogというのはLLVMで言うバックエンドに相当する部分であると説明にも書いてある。 FIRRTL自体はScalaで記述されており、動…