FPGA開発日記
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CMakeでVerilogシミュレーション環境を構築する
Verilogで久し振りに回路設計をしているのだが、ビルドの標準環境としてCMakeを使いたい。 CMakeでVerilogを構築する手法については、以下の日記でトライしてみた。これを今度は実用してみよう。 msyksphinz.hatenablog.com msyksphinz.hatenablog.com 1. Vivado Simulatorの環境を構築するためのCMakeLists.txt CMakeList…