FPGA開発日記

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2021-04-07から1日間の記事一覧

Verilatorのコンパイルフローを観察する (6. 007_JumpLinkのソースコードを読む)

whileブロックの内部解析続き。break文がどのように分解されているのかを観察する。以下のようなVerilogファイルを題材に観察している。 module while_jump; int i; initial begin while(i < 100) begin if (i == 10) break; i++; end end endmodule これら…