FPGA開発日記

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2020-01-28から1日間の記事一覧

TileLinkのDiplomacyデザインの解析 (1. AddressDecoderによるアドレス重複チェック)

Diplomacyを使ったバスの設計では、Chiselの機能を使って設計段階で様々な問題を事前にチェックすることができる。例えば、スレーブノード(Managerノード)のアドレスマップが被っているかどうかをチェックすることができる。 例えば以下のデザインで、TLRAM…