FPGA開発日記

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2016-05-22から1日間の記事一覧

ReadyとValidを制御するためのSkid Buffer

通常のデジタル回路設計において、特定のブロックとの信号をやり取りするのに、ReadyとValidを使うことができる。 Validは送信元がデータ送信を示すのに利用し、Readyは送信先のユニットがデータ受け入れ可能であることを示す。 ReadyとValidの制御について…