FPGA開発日記

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2015-12-05から1日間の記事一覧

Vivado 2015.4 HLSを試す(Interface Synthesis Lab 2)

Interface Synthesis Lab 2: Port I/O Protocolをやっていこう。 http://www.xilinx.com/support/documentation/sw_manuals/xilinx2013_1/ug871-vivado-high-level-synthesis-tutorial.pdf Step1. Create and Open the Project まずは、CUIでvivadoを起動し…